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本发明涉及提供一种单个非易失性器件存储正负权重的突触结构，包括：第一非易失性存储器(NVM)列、第二NVM列、电流电压转换器(IVC)、激活函数电路、共模信号计算电路和共模信号抽取电路；该第一NVM列和第二NVM列的输入端与输入信号组直接连接，该第一NVM列的输出端与IVC的输入端连接，IVC的输出端与激活函数电路输入端连接，该第二NVM列的输出端与共模信号计算电路输入端连接，共模信号计算电路的输出端与共模信号抽取电路的输入端连接，共模信号抽取电路的输出端与第一NVM列输出端连接。本发明在神经网
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116451751 A
(43)申请公布日 2023.07.18
(21)申请号 202210007217.X
(22)申请日 2022.01.05
(71)申请人 湖南大学
地址 410082
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