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- 2023-07-26 发布于四川
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本实用新型公开了延迟电路和包括该延迟电路的半导体装置。该延迟电路包括:第一延迟锁定环,其包括与时钟信号输入端连接的且由第一组延迟单元构成的第一延迟链;以及第二延迟锁定环,其包括与时钟信号输入端连接的且由相互连接的第二组延迟单元和第三组延迟单元构成的第二延迟链,其中,第一组延迟单元输出的第一延迟信号的第一延迟时间、第二组延迟单元输出的第二延迟信号的第二延迟时间以及第三组延迟单元输出的第三延迟信号的第三延迟时间各不相同,并且第一延迟时间大于第三延迟时间。通过本实用新型提供的技术方案,可以减小不同延迟
(19)中华人民共和国国家知识产权局
(12)实用新型专利
(10)授权公告号 CN 209897029 U
(45)授权公告日
2020.01.03
(21)申请号 20192
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