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本发明公开了一种适用于JESD204B协议标准的高速并串转换电路，包括高速串行复接单元、两个第一复接单元、延时单元和第二复接单元，所述高速串行复接单元用于接收多路输入的并行数据，并通过并串转换将输入的多路并行数据转换为四路串行数据分别输出给两个第一复接单元，两个所述第一复接单元的输出端分别通过延时单元与第二复接单元电连接。本发明采用树形结构和串行结构结合的方式，将多比特的并行数据转化为串行数据，最高可将40bits的并行数据转化为1bit的串行数据，速率可高达10Gbps，提高了并行数据的处理能
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 111865330 A
(43)申请公布日 2020.10.30
(21)申请号 202010774991.4
(22)申请日 2020.08.05
(71)申请人 中国电子科技集团公司第二十四研
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