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本发明提供了一种通用型异步串口的FPGA实现方法,至少包括以下步骤:构建FPGA中各处理模块的控制逻辑;载荷设备通过串口收发芯片向FPGA发送数据,串并转换模块在串口信号起始位的下降沿到来时跳转到数据接收状态;接收完第一帧数据的校验位后转换到校验状态,并开始接收终止位和数据校验;若第一帧串口信号数据校验结果合格则输出至接收数据缓存模块,否则丢弃;FPGA的并串转换模块在并行数据信号的上升沿到来时跳转到数据发送状态;首先发送起始位同时计算校验位,再从低位到高位依次发送并行数据信号后发送校验位,最后
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116795759 A
(43)申请公布日 2023.09.22
(21)申请号 202310646778.9
(22)申请日 2023.06.02
(71)申请人 上海蓝箭鸿擎科技有限公司
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