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本发明提供了一种修正CPLD内部时钟频率的装置及方法,装置包括:测试板,测试板包括:可编程器件;外部晶振,连接于可编程器件,并配置用于产生外部时钟;以及插槽,连接于可编程器件;待测板卡,配置用于插入至插槽,待测板卡包括:待测CPLD,待测CPLD具有内部时钟;可编程器件配置用于基于外部时钟的第一频率得到内部时钟的第二频率,并确定第二频率与指定频率的偏差值,并将偏差值发送至待测板卡;待测板卡中的待测CPLD配置用于基于偏差值将第二频率修正为指定频率,以作为待测CPLD的系统时钟频率。本发明实现了使
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116841347 A
(43)申请公布日 2023.10.03
(21)申请号 202310797472.3
(22)申请日 2023.06.30
(71)申请人 苏州浪潮智能科技有限公司
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