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本发明公开了一种鉴相器、鉴相单元及延迟锁相环电路，包括电路结构相同的第一鉴相单元和第二鉴相单元；第一鉴相单元或第二鉴相单元由动态鉴相结构和下降沿延迟反相器组成。本发明采用下降沿延迟反相器对输入信号进行延迟，有效地延长了鉴相器输出脉冲的宽度，从而解决了鉴相死区的问题；同时本发明中鉴相器在参考信号以及反馈信号两个输入信号相位差较小时，输出的第一、第二脉冲在宽度以及高度上具有较大的差别，从而能够有效克服由于延迟锁相环电荷泵充放电电流不匹配导致的静态相位偏差问题；此外本发明鉴相器输出不会存在缓慢的脉冲，
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116865748 A
(43)申请公布日 2023.10.10
(21)申请号 202310801748.0
(22)申请日 2023.06.30
(71)申请人 中山大学
地址 510275
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