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本发明涉及人工智能芯片领域，提供一种卷积电路及其控制方法、神经网络加速器和电子设备，卷积电路包括卷积计算单元，卷积计算单元包括选择器组、特征寄存器组、权重寄存器组、乘法器组、加法器组和结果寄存器组；选择器组用于通过输入选择器将输入的特征数据缓存至特征寄存器组，还用于通过移位选择器将缓存的特征数据移位；特征寄存器组用于缓存输入的特征数据并将P个特征数据提供给乘法器组；权重寄存器组用于缓存输入的P个权重数据；乘法器组用于计算对应的权重数据与对应的特征数据的乘积；加法器组用于对乘法器组的计算结果进行累
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117273095A
(43)申请公布日2023.12.22
(21)申请号202311048652.8
(22)申请日2023.08.18
(71)申请人中国科学院半导体研究所
地址1
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