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本公开实施例公开了一种时钟控制电路和半导体存储器，包括：第一解码路径、第二解码路径和时钟控制电路。第一解码路径，被配置为接收初始命令信号和初始时钟信号，在初始时钟信号的触发下对初始命令信号移位并解码，得到并输出第一解码信号。第二解码路径，被配置为接收初始命令信号，对初始命令信号解码，得到并输出第二解码信号；第二解码信号的前沿超前于第一解码信号的前沿。时钟控制电路，用于接收初始时钟信号、第一解码信号和第二解码信号，用于根据第一解码信号和第二解码信号对初始时钟信号进行门控，输出时钟门控信号。本公开能
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117352020A
(43)申请公布日2024.01.05
(21)申请号202210760907.2
(22)申请日2022.06.29
(71)申请人长鑫存储技术有限公司
地址23
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