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一种比较器失调校准装置及模数转换器。所述比较器失调校准装置校准逻辑控制单元、校准DAC单元及比较器控制单元；其中：所述校准逻辑控制单元，与待校准比较器连接，用于在所述待校准比较器失调时，生成校准码并存储；所述校准DAC单元，与所述逻辑控制单元连接，用于获取所述逻辑控制单元生成的校准码，并基于所述校准码产生校准信号，利用所述校准信号对所述待校准比较器进行校准；所述比较器控制单元，与所述校准逻辑控制单元连接，用于实时检测是否满足预设校准结束条件，并在满足所述预设校准结束条件时，生成检测结果信号，以关
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117560003A
(43)申请公布日2024.02.13
(21)申请号202311661672.2
(22)申请日2023.12.05
(71)申请人广东省大湾区集成
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