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本发明提供了一种实现I2C底层驱动的方法、装置及可读介质,该方法以FPGA作为I2C主机,对从设备进行读时序控制及写时序控制;写时序控制包括空闲状态、起始状态、发送数据状态及停止状态;读时序控制包括空闲状态、起始状态、发送数据状态、接收数据状态及停止状态;方案通过对各状态的跳转控制,完成主机对从机的数据写入及读取操作。本方案可根据不同I2C从设备的读写时序构建驱动程序,构建程序的时候无需改变I2C驱动代码,可兼容符合I2C协议的从设备的读写操作,提高了代码的复用率和工作效率。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117648084A
(43)申请公布日2024.03.05
(21)申请号202410114977.X
(22)申请日2024.01.29
(71)申请人井芯微电子技术(
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