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本发明提供一种基于VIVADO平台的SM2椭圆曲线素数域模乘器的FPGA实现方法，对模乘计算采用了单独模块来完成，和使用多个模块的实现方式相比，减少了模块交互额外占用的时钟；并将可以同时计算且互不影响的部分尽量放在一个时钟，将并行尽可能最大化；通过优化加减法运算过程和运算中的wire变量，一方面可以将许多操作并行计算，减少时钟数；另一方面，wire变量由组合逻辑电路实现，如果wire变量的表达式足够精简，则组合逻辑电路的复杂度也会降低，从而提高时序可靠性，降低LUT数量和实现面积；本发明一次模乘
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117667017A
(43)申请公布日2024.03.08
(21)申请号202311373352.7
(22)申请日2023.10.23
(71)申请人北京遥测技术研究所
地址100
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