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- 2024-05-29 发布于四川
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本发明公开了一种FPGA并行架构的多通道触发偏移调节方法，所述FPGA并行架构包括上位机和两个FPGA处理板，每一个FPGA处理板的输入端均连接有两个信号输入通道，所述多通道触发偏移调节方法包括以下步骤：S1.主从处理板设置及通道定义；S2.触发源选择和预触发深度设置；S3.通道偏移计算；S4.通道触发偏移同步校准；S5.各个通道的触发偏移调节。本发明首先对两片FPGA的信号输入通道进行偏移校正，使得同步间保持触发同步，然后在触发同步的基础上，能够根据用户需求对触发偏移进行控制，方便于进行不同信
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN118091221A
(43)申请公布日2024.05.28
(21)申请号202410490025.8
(22)申请日2024.04.23
(71)申请人成都玖锦科技有限公司
地址61
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