786-测试试卷-时序逻辑电路的分析与设计.pdf

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自我检测

1.T7.10ZCP

时序逻辑电路如图所示，触发器初态为。是的分频。

A.3

B.4

Q1Q2

1D1D

C.5C1C1

D.6R

图T7.1

2.采用触发器构成计数器。计数器的输入、输出波形如图T7.2所示，至少需要

个触发器。

A.4CP

B.3

C.1Q0

D.2

图T7.2

3.电路如图T7.4所示，假设初始状态QQQ=000。由FF和FF构成的是进

21010

制计数器。整个电路为进制计数器。

A.三，五

QQQ

012

B.三，六1J1J1J

C1FF0C1FF1C1FF2

C.四，五

1K1K

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