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安徽大学数字电路期末试卷及答案
考试时间：______分钟总分：______分姓名：______
一、
简述组合逻辑电路和时序逻辑电路的区别。组合逻辑电路的输出仅取决于当前输入，时序逻辑电路的输出不仅取决于当前输入，还取决于电路的过去状态。组合电路没有记忆功能，时序电路具有记忆功能。组合电路由逻辑门构成，时序电路由逻辑门和触发器构成。
二、
已知逻辑函数F(A,B,C)=Σm(1,2,4,7)，请分别用最小项之和的形式和最大项之积的形式表示该逻辑函数。
三、
设计一个一位二进制加法器，输入为A,B，输出为S和COut。要求写出真值表，并推导出S和COut的逻辑表达式。
四、
分析如下电路的逻辑功能，其中F是输出，A,B是输入。
```
B
|
|
A---[与门]---[非门]---+
||
||
+-[与门]---F
|
|
B---[与门]
```
五、
写出下列状态转换图的逻辑状态表，并说明其逻辑功能。
```
00
/\
0111
\/
10
```
六、
设计一个模4同步计数器，要求写出状态转换表，并画出逻辑电路图（使用D触发器）。
七、
解释什么是竞争冒险现象，并简要说明消除竞争冒险的几种方法。
八、
简述VerilogHDL中模块的定义方法，并说明模块中通常包含哪些部分。
九、
用VerilogHDL语言描述一个2-4线译码器，输入为A1,A0，输出为Y0,Y1,Y2,Y3。
十、
分析如下VerilogHDL代码描述的逻辑电路的功能。
```verilog
moduleexample(inputclk,inputreset,inputd,outputq);
regq;
always@(posedgeclkorposedgereset)begin
if(reset)begin
q=0;
endelsebegin
q=d;
end
end
endmodule
```
试卷答案
一、
组合逻辑电路的输出仅取决于当前输入，时序逻辑电路的输出不仅取决于当前输入，还取决于电路的过去状态。组合电路没有记忆功能，时序电路具有记忆功能。组合电路由逻辑门构成，时序电路由逻辑门和触发器构成。
解析思路：本题考察组合逻辑电路和时序逻辑电路的基本概念和区别。核心在于理解组合电路输出与输入的即时关系，以及时序电路输出与输入、电路状态历史的关系。
二、
最小项之和形式：F(A,B,C)=ABC+ABC+ABC+ABC
最大项之积形式：F(A,B,C)=(A+B+C)(A+B+C)(A+B+C)(A+B+C)
解析思路：将给定的最小项之和形式转换为最大项之积形式，需要利用公式A+B=(AB)和AB+AB=(A+B)。首先，将最小项转换为最大项：m1对应M0，m2对应M5，m4对应M2，m7对应M4。然后，根据最大项的定义，写出最大项之积形式。
三、
真值表：
|A|B|S|COut|
|---|---|---|-------|
|0|0|0|0|
|0|1|1|0|
|1|0|1|0|
|1|1|0|1|
S=A⊕B
COut=A∧B
解析思路：一位二进制加法器需要考虑进位。首先，列出所有可能的输入组合（A,B）。根据二进制加法规则，计算对应的和（S）和进位（COut）。然后，根据真值表，写出S和COut的逻辑表达式。S是A和B的异或，COut是A和B的与。
四、
F=B·(B+A)=B·A
解析思路：分析电路逻辑，从输入B开始，经过第一个与门和第一个非门，得到B。B再经过第二个与门，与A相与，得到最终输出F=B·A。这是与非门的功能。
五、
逻辑状态表：
|现在状态|输入|下一个状态|
|----------|------|------------|
|00|00|00|
|00|01|01|
|01|00
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