《数字电路的分析与实践》课件——4.3集成主从和边沿触发器.pptxVIP

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2026-01-08 发布于福建
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《数字电路的分析与实践》课件——4.3集成主从和边沿触发器.pptx

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任务4.3集成触发器

集成主从RS触发器74LS71集成边沿触发器目录集成边沿触发器的应用实例

一、集成主从RS触发器74LS71逻辑符号引脚分布图该触发器有三个S端和3个R端，它们之间分别为与逻辑关系，即1R=R1·R2·R3,1S=S1·S2·S3。

一、集成主从RS触发器74LS7174LS71的功能真值表74LS71触发器具有异步置1和清零功能，异步的含义是不受控于CP，当异步置1端加低电平，异步清零端加高电平，触发器不需要等待CP而直接置1，反之触发器直接置0。

二、集成边沿触发器1.集成边沿D触发器74LS74引脚和内部结构图引脚分布图74LS74是CP上升沿触发的边沿D触发器，特性方程是Qn+1=D。两个异步预置端的功能如下：时，触发器直接置0；当时，触发器置直接1；当时，D触发器根据CP和D正常工作。

二、集成边沿触发器1.集成边沿D触发器74LS7474LS74的功能真值表

二、集成边沿触发器2.集成边沿JK触发器74LS112引脚和内部结构图引脚分布图常见的集成产品74LS112是带异步置位和复位端的下降沿触发的双JK触发器，内部含有两个相同的边沿JK触发器。

二、集成边沿触发器2.集成边沿JK触发器74LS11274LS112功能真值表74LS112双JK触发器的功能：（1）和可将触发器状态直接置为1或0；（2）时，有五种情况：①CP下降沿未到时，触发器保持原状态；②当J=K=0，CP下降沿到来时，触发器保持原状态；③当J=0，K=1，CP下降沿到来时，触发器置“0”；④当J=1，K=0，CP下降沿到来时，触发器置“1”；⑤当J=K=1，CP下降沿到来时，触发器状态翻转。

三、集成边沿触发器的应用实例利用JK触发器74LS112构成的单按钮电子转换开关电路，该电路只利用一个按钮即可以实现电路的接通与断开。

小结触发器具备存储记忆功能，是时序逻辑电路的基本组成单元。它是一种双稳态数字电路，1位触发器能够存储1位二进制数，即0和1。主从和边沿触发器只在CP的上升沿和下降沿打开，解决了同步触发器的空翻现象。理论上，用集成触发器可以设计和实现任意N分频电路。

谢谢大家！