计算机科学术语第2部分:通用验证方法语言参考手册标准立项发展报告
StandardizationDevelopmentReport:SystemVerilog-Part2:UniversalVerificationMethodologyLanguageReferenceManual
摘要
随着集成电路设计复杂度的不断提升,功能验证已成为芯片开发流程中耗时最长、成本最高的环节之一。通用验证方法学(UniversalVerificationMethodology,UVM)作为基于SystemVerilog的标准化验证框架,自2011年发布以来已在全球半导体行业得到
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