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一、单项选择题

1.下列关于组合逻辑电路的说法中，正确的是（）。

A.组合逻辑电路的输出仅取决于当前时刻的输入，与电路的历史状态无关。

B.组合逻辑电路的输出不仅取决于当前时刻的输入，还与电路的历史状态有关。

C.组合逻辑电路不存在反馈回路。

D.组合逻辑电路的输出只与电路的结构有关，与输入无关。

2.在下列逻辑门中，实现“或非”逻辑功能的门是（）。

A.与门

B.或门

C.非门

D.或非门

3.下列关于时序逻辑电路的说法中，错误的是（）。

A.时序逻辑电路的输出不仅取决于当前时刻的输入，还与电路的历史状态有关。

B.时序逻辑电路中必须包含存储元件。

C.时序逻辑电路的输出只与电路的结构有关，与输入无关。

D.时序逻辑电路的状态转换是由时钟信号控制的。

4.在VerilogHDL中，表示“恒等”操作符的是（）。

A.==

B.=

C.===

D.=

5.下列关于寄存器的说法中，正确的是（）。

A.寄存器是数字系统中用于存储数据的逻辑部件。

B.寄存器只能存