(毕业论文)基于FPGA的自动打铃器设计.doc

基于FPGA的自动打铃器的设计 学 院 电 子 工 程 学 院 学 号 班 级 A1121班 专 业 电 子 信 息 工 程 姓 名 指 导 教 师 目 录 第一章 绪论 4 1.1选题目的 4 1.2 FPGA的发展历程 4 1.2.1 FPGA的优点 5 1.3器件及工具介绍 5 1.3.1 QuartusⅡ设计步骤 5 第二章 系统方案设计 5 2.1设计方案分析与选择 5 2.2自动打铃器总体构成 6 2.3分频模块设计 7 2.4消抖模块设计 8 2.5时钟模块设计 8 2.5.1秒计数模块 9 2.5.2分计数模块 9 2.5.3时计数模块 10 2.5.4调时模块 11 2.6闹钟模块设计 12 2.6.1定时模块 12 2.6.2比较模块 13 2.7打铃模块设计 15 2.8报警模块设计 17 2.8.1报警时长设定模块 17 2.8.2蜂鸣器发声模块 17 2.9显示模块设计 18 2.9.1时间切换模块 18 2.9.2动态扫描模块 20 2.10按键电路设计 22 第三章 实验结果分析 22 3.1测试过程 22 3.2结果分析 23 参考文献 25 附 录 26 摘 要 自动打铃器为学校上下课时间的准确控制提供了很大的便利，并且在工厂、办公室等场合也起到了提醒人们时间的作用，因此打铃器的设计有一定的实用意义。 本设计的学校打铃器采用基于现场可编程门阵列（FPGA）的方法，底层模块采用硬件描述语言（HDL）设计，不仅能对时、分、秒正常计时和显示，而且还可进行闹铃时间的设定，上下课时间报警，报警时间1-15秒设置。系统主芯片采用美国Altera公司的EP3C40F484I7器件，由时钟模块、控制模块、闹钟模块、定时模块、数据译码模块、显示以及报时等模块组成，由按键进行时钟的校时、清零、启停等。本文在介绍FPGA器件的基础上，着重阐述了如何使用FPGA器件进行系统的开发，以及如何实现学校打铃系统。通过仿真验证及实际测试，打铃器具有正常计时、定时报警、报警时长设定等功能，可为日常作息提供准确、便捷的提醒。 系统运行稳定，设计方法可行。 关键词：打铃器 现场可编程门阵列 硬件描述语言 第一章 绪论 1.1选题目的 当今社会，电子技术的应用无处不在，电子技术正在不断地改变我们的生活，改变着我们的世界。在这快速发展的年代，时间对人们来说是越来越宝贵，在快节奏的生活时，人们往往忘记了时间，一旦遇到重要的事情而忘记了时间，这将会带来很大的损失。因此我们需要一个定时系统来提醒这些忙碌的人。数字化的时钟给人们带来了极大的方便。近些年，随着科技的发展和社会的进步，人们对时钟的要求也越来越高，传统的时钟已不能满足人们的需求。多功能数字钟不管在性能还是在样式上都发生了质的变化，自动打铃器就是以时钟为基础的，在平时校园生活中是必不可少的工具。 自动打铃器的数字化给人们生产生活带来了极大的方便，而且大大地扩展了时钟原先的报时功能。诸如定时自动报警、定时启闭电路、定时开关烘箱、通断动力设备，甚至各种定时电气的自动启用等，所有这些，都是以时钟数字化为基础的。因此，研究时钟及扩展应用，有着非常现实的意义。 本设计将借助EDA技术，完成基于FPGA器件的学校打铃器的设计。EDA技术的发展经历了一个由浅到深的过程，先后经历了CAD、CAE和现代意义上的EDA三个阶段。在可编程逻辑器件（PLD）内部，数字电路可用硬件描述语言可以进行方便的描述，经过生成元件后可作为一个标准元件进行调用。同时，借助于开发设计平台，可以进行系统的仿真和硬件测试等。 对于数字电子技术实验和课程设计等，特别是数字系统性的课题，借助PLD器件和硬件描述语言等开发手段，即可设计出各种比较复杂的数字系统，如设计频率计、交通控制灯、秒表等，有助于实验质量的提高和对学生综合能力的锻炼。同时，作为电子信息工程专业的学生，EDA技术应用于毕业设计中，可快速、经济地设计各种高性能的电子系统，并且很容易实现、修改及完善。 1.2 FPGA的发展历程 作为一种可编程逻辑器件，现场可编程门阵列（Field Programmable Gate Array，FPGA）的出现是PLD发展变化的必然，他的出现推动着可编程逻辑器件的进一步发展。因此说，了解了可编程逻辑器件的发展历程，也就了解了FPGA的发