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No.6 微 处 理 机 第6期
I)ec..2O12 MICROPROCESSORS 20l2年 l2月
COMS电路的参数提取及模型建立
冯海涛,裴志强,刘宝娟
(中国电子科技集团公司第四十七研究所,沈阳110032)
摘 要:静态时序分析是验证时序是否收敛的重要手段,但它需要准确的时序模型,尤其是全
定制电路不能使用一般晶圆工厂提供的时序工艺库。这里介绍了使用 synopsys公司的各种:【具进
行寄生参数的提取,瞬态分析和时序模型的建立,并以传输管为例,详细描述 了建立查找表时序模
型的流程。
关键词:参数提取;静态时序分析;时序模型
DOI编码:10.3969/j.issn.1002—2279.2012.06.002
中图分类号:TN4 文献标识码 :A 文章编号:1002—2279(2012)06—0004—02
ParameterExtractionandModelling0fCM0S Circuit
FENGHai—tao,PEIZhi—qiang,LIUBao—juan
(The47thResearchInstituteofChinaElectronicsTechnologyGroupCorporation,Shenyang110032,China)
Abstract:Statictiminganalysisisanimportantmethodtoverifytheconvergenceoftiming,butit
requireaccuratetimgmodel,especiallythefullcustomedcircuitcannotusethecommontimingtechnolo—
gYlibraryprovidedbythefoundary.Introducedextractionofparasiticalparameters,transientanalysisand
buildingoftimingmodelsbyusingsynopsystools,andusingtransport transistorsasanexample,depicted
flow ofconstitutingtimingmodelsoflooking—uptable.
Keywords:ParameterExtraction;STA ;Timingmodels
序分析使用查找表模型。
l 引 言
2.2 查找表时序模型建立流程
随着器件的特征尺寸降到深亚微米级,器件的物 建立时序模型的关键主要有下面几个步骤:
理特性和电学特性发生了很大的变化。由此导致的 · 建立版图单元和逻辑单元的对应关系;
时序不收敛是深亚微米设计中最常见的问题,因此一 · 提取线网的寄生参数文件;
般会对设计进行静态时序分析。进行静态时序分析 · 建立单元版图的时序模型。
需要用到包括设计中所有单元时序信息的时序工艺 图1给出了实现上面几个步骤比较详细的流
库,但是,一般晶圆工厂提供的时序工艺库只包括了 程 。
基本单元的时序信息,对于全定制电路来说也不适 为了进行详细的时序分析,确保设计的芯片在
用。这里就详细阐述一下使用 synopsys的各种工具 各种条件下可以正常工作,需要对每个单元在最好、
进行寄生参数的提取以及时序模型的建立方法。 最坏和典型情况下,以不同的输出负载,不同的输人
驱动能力和
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