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数字逻辑第三章作业答案.doc
第3章作业答案:第四版
3.11
A B C D Q1 Q2 Q3 Q4 Q5 Q6 Q7 Q8 Z L L L L off on off on off on off on H L L L H off on off on on on off off L L L H L off on off on off off on on L L L H H off on off on on off on off L L H L L off on on off off on off on H L H L H off on on off on on off off L L H H L off on on off off off on on L L H H H off on on off on off on off L H L L L on off off on off on off on H H L L H on off off on on on off off L H L H L on off off on off off on on L H L H H on off off on on off on off L H H L L on off on off off on off on L H H L H on off on off on on off off L H H H L on off on off off off on on L H H H H on off on off on off on off L
3.12
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3.13 3-input CMOS NOR gate
A B C Q1 Q2 Q3 Q4 Q5 Q6 Z L L L off on off on off on H L L H off on off on on off L L H L off on on off off on L L H H off on on off on off L H L L on off off on off on L H L H on off off on on off L H H L on off on off off on L H H H on off on off on off L
74HC00的DCnoise margin
LOW STATE:1.35-0.33(0.1) = 1.02(1.25)V HIGH STATE: 3.84 (4.4)-3.15=0.69 (1.25)V
括号里的数值表示输出驱动CMOS负载时的直流噪声容限
3.56
LOW state HIGH state VIlmax VOlmax noise margin VIHmin VOhminT noise margin (a) 74HCT driving 74LS 0.8V 0.33V 0.47V 2.0V 3.84V 1.84V 74LS driving 74HCT 0.8V 0.5V 0.3 V 2.0V 2.7V 0.7 V (b) 74ALS driving 74HCT 0.8V 0.5V 0
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