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实验六 可定时的八路数显抢答器 实验要求 1.掌握可定时的八路数显抢答器的工作原理及其设计方法； 2.进一步熟悉74系列常用中规模集成芯片的应用，提高对硬件电路的分析能力； 3.进一步熟悉QartusII软件的使用； 4.学习较复杂的数字系统文本输入（VHDL、Veril HDL）和原理图输入的设计方法。 抢答器功能要求 基本功能： （1）设置一个系统清除和抢答控制开关，由主持人控制；（2）抢答器同时供8名选手或8个代表队比赛； （3）抢答器具有锁存与显示功能。 扩展功能： （1）抢答器具有定时抢答功能，可由主持人设置时间； （2）参赛选手在设定的时间内进行抢答，抢答有效， 如果定时时间已到，无人抢答，本次抢答无效。 实验原理 抢答器电路 定时电路 分频程序 * * 优 先 编 码 器 锁 存 器 抢 答 按 钮 译 码 器 显 示 器 74148 74249 7447 Led或数码管 开关 倒 计 时 电 路 秒 脉 冲 电 路 译 码 器 显 示 器 7447 Led或数码管 74192 外部脉冲 或分频 PIN_N2 1Hz Verilog代码 module Fdiv(Clock_In,Clock_Out); input Clock_In; output Clock_Out; reg Clock_Out; reg[32:0] count; parameter N = always @ (posedge Clock_In) if ( count N) begin count = count + 1b1; end else begin count = 1b0; Clock_Out = ~Clock_Out; end endmodule
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