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毕业设计论文 基于FPGA的直接数字频率合成器的设计 摘要 在频率合成领域，常用的频率合成技术有直接模拟合成、模拟锁相环、小数分频锁相环等，直接数字频率合成（Direct Digital Frequency Synthesis ，DDFS，简称DDS）是近年来的新的频率合成技术。本文介绍了直接数字频率合成器的基本组成及设计原理，给出了基于FPGA的具体设计方案及编程实现方法。仿真结果表明，该设计简单合理，使用灵活方便，通用性好，可写入各种FPGA芯片，最高可将频率提高100万倍。具有良好的性价比。 关键词 直接数字频率合成器(DDS) FPGA Design of direct digital frequency synthesizer based on FPGA Abstract In Frequency domain, the common Synthesis technology has Direct simulation, phase lock loop simulation, decimal Frequency and phase lock loop, Direct Digital Frequency Synthesis (as some DDFS, Digital, referred to as spurious bio-synthesis) in recent years is the new Frequency Synthesis technology. The structure and principles of Direct Digital Frequency Synthesizer is introduced. Also a detailed design and the method of program realization based on FPGA are introduced. The result of simulation shows that the design is simple and feasible, convenient and flexible, high universality, writeable various FPGA chip, the highest frequency can be 100 million times. Ratiofor quality to price. Keywords Direct Digital frequency Synthesizer(DDS) FPGA 前言 在频率合成领域，常用的频率合成技术有直接模拟合成、模拟锁相环、小数分频锁相环等，直接数字频率合成（DDS）是近年来的新的频率合成技术。DDS以稳定度高的参考时钟为参考源，通过精密的相位累加器和数字信号处理，再通过高速D/A变换器产生所需的数字波形，这个数字滤波经过一个模拟滤波器后，得到最终的模拟信号波形。DDS是产生高精度、快速频率变换、输出波形失真小的优先选用技术。 随着可编程逻辑器件的飞速发展，使用FPGA（Field－Programmable Gate Array）设计DDS系统成为一种很好的选择，由于FPGA现场可编程，设计复杂或者简单系统完全从实际需要出发，通过重写RAM/ROM数据，可以做到任意波形输出和动态波形输出，这是其他方法所无法比拟的。本章提出了一种基于FPGA的直接数字频率合成设计方法，并利用比例乘法器，将频率分辨率提高到惊人的程度。 目录 1 DDS原理 1 1.1 直接模拟（DAS） 1 1.2 间接式频率合成（PLL） 1 1.3 直接数字频率合成（DDS） 2 2 系统设计 6 2.1 微控制器接口模块 8 2.2 相位累加寄存器 8 2.3 双端口RAM 8 3 模块设计与实现 15 3.1 微控制器接口模块 15 3.1.1 分频寄存器（FWORD1-FWORD4) 16 3.1.2 控制寄存器（DDSCR) 16 3.1.3 数据输入寄存器（DATA） 17 3.2 比例乘法器模块 31 3.3 相位累加器模块 37 3.4 双端口RAM模块 39 致 谢 48 参考文献 49 DDS原理 顾名思义频率合成技术，就是能从一个高稳定和准确度的标准频率中产生千百万个同一高稳定度和准确度的频率。频率合成技术广泛地应用于通信、导航、雷达、仪器仪表、军事装备等领域、现代的电子系统对频率合成器提出越来越高的要求，主要表现在：转换速度快、频段宽、步进间隔小、杂散小、体积小、重量轻、功耗低等。随着大规模集成电路的发展，频率合成技术日趋完善，目前，主要有以下几种方式。 1.1 直接模拟（DAS） 直接模