电子科技大学2015年836信号与系统和数字电路试题.pdfVIP

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2015-09-26 发布于北京
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电子科技大学2015年836信号与系统和数字电路试题.pdf

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电子科技大学2015年836信号与系统和数字电路试题

电子科技大学 2015 年攻读硕士学位研究生入学考试试题考试科目：836 信号与系统和数字电路数字电路部一、单项选择题：（每小题 2 分，共 16 分）（1）、若函数F   (0,2,5,6,9,12,13,15) ，F   (0,2,3,6,9,10,13,15) ， 1 A,B,C,D 2 A,B,C,D F   (3,5,10,12) ，则有（）。 3 A,B,C,D D D A ．F  F B. F  F  F C. F  F F D. F  F F 2 1 3 1 2 3 1 2 3 1 2 （注：F ’表示F 取非；F D 表示F 的对偶式） 2 2 2 2 （2 ）、已知F  WYZWXZ WXY XYZ ，用如图1.1 所示的“与非异或”电路实现F，要求两个与非门的输入只能为原变量，则两个与非门的输入分别为（）和（）。 A ．（W ，X ），（Y ，Z ） B ．（W ，Y ），（X ，Z ） C ．（W ，Z ），（X ，Y ） D ．（W ，Y ），（X ，Y ） 2 （3 ）、 X 为3 位无符号二进制数，Y=X +X ，要实现Y ，至少需要用（）片74x138 （三八译码器，输出为低电平有效）和（）个与非门。 A ．（1），（4 ） B ．（1），（5 ） C ．（1），（6 ） D ．无法实现（4 ）、某8 位比较器能够比较输入P 、Q 的大小，其输出FP=Q 和FPQ 均为低电平有效（即P=Q 时FP=Q=0 ，PQ 时FPQ=0 ）。要产生高电平有效的FPQ （即PQ 时FPQ=1 ），可以将FP=Q 和 FPQ 接到（）实现。 A ．与门 B ．或门 C ．与非门 D ．或非门（5 ）、下列存储单元中，不能用来构成移位寄存器的是（）。 A. 主从式S-R 触发器 B. T 触发器 C. D 锁存器 D. 边沿触发式J-K 触发器（6 ）、如图1.2 所示的地址译码电路，S0_L~S7_L 分别接到不同设备的使能端（低电平有效），则在A7~A0 为（）（用十六进制表示）时，S7 被选中。 A ．2716 B ．3716 C ．4716 D ．5716 共8 页第 1 页或非门