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EDA技术模拟考试题.doc
《EDA技术》模拟考试题
1. 用并行语句设计一个函数发生器。输入信号为A0,A1,A2,输出信号为D0,D1,D2。输入信号经过3-8译码后,按照如下函数进行输出,D2(A2,A1,A0)=Σm(5,3,2)、D1(A2,A1,A0)=Σm(7,3,1,0)、D0(A2,A1,A0)=Σm(6,5,4,3)。【本题20分】
library ieee;
use ieee.std_logic_1164.all;
entity test1 is
port(a:in std_logic_vector(2 downto 0);
d:out std_logic_vector(2 downto 0));
end;
architecture bhv of test1 is
signal y: std_logic_vector(7 downto 0);
begin
ywhen a=111 else
when a=110 else
when a=101 else
when a=100 else
when a=011 else
when a=010 else
when a=001 else
when a=000 else
;
d(2)= y(5) or y()3) or y(2);
d(1)= y(7) or y(3) or y(1) or y(0);
d(0)= y(6) or y(5) or y(4) or y(3);
end;
2. 设计一个序列检测器,要求当检测器连续收到一组串行编码“1110010”后,输出为1,其它情况下输出为0。要求画出状态转换图,仿真结果中必须出现输出为1的情况。【本题20分】
library ieee;
use ieee.std_logic_1164.all;
entity test2 is
port(rst,clk:in std_logic;
din:in bit;
dout:out bit);
end;
architecture bhv of test2 is
type state is(s0,s1,s2,s3,s4,s5,s6,s7);
signal ps,ns:state;
begin
reg: process(rst, clk)
begin
if rst=1 then
ps=s0;
elsif clkevent and clk=1 then
ps=ns;
end if;
end process;
com: process(ps)
begin
case ps is
when s0=dout=0;
if din=1 then
ns=s1;
else
ns=s0;
end if;
when s1=dout=0;
if din=1 then
ns=s2;
else
ns=s0;
end if;
when s2=dout=0;
if din=1 then
ns=s3;
else
ns=s0;
end if;
when s3=dout=0;
if din=1 then
ns=s1;
else
ns=s4;
end if;
when s4=dout=0;
if din=1 then
ns=s1;
else
ns=s5;
end if;
when s5=dout=0;
if din=1 then
ns=s6;
else
ns=s0;
end if;
when s6=dout=0;
if din=1 then
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