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Abstract
Abstract
with
ADChasbeen in and field
Pipeline adoptedwidelyhigh··speedhigh··precision
andthe of
its theincreaseoftheeffectivebits frequency
advantages．However,with
ofclockiRerand hasa influence
signal，the j dutycycle key
inputanalog performance
theresearchofthe
onthestaticand intheADC．Therefore
dynamicperformances
circuitwhichCan aclock with andlow is
provide signal 50％dutycycle jittergetting
andmoreattentionsfrom
more designers．
Basedonthe article anew itter
research，this fast—locking，low-j
existing proposes
and CMOSwidthcontrolbasedonthe of
high．precisionpulse loop theorydelaylocking
of the
circuitachievesthemodulation usingsingleedge
loop．Theproposed dutycycle
ofclock．Thismethod the ofADCand the ofthe
performance lightspressure
guarantees
withafollower
clock source．For pump
signal highprecision，animprovedcharge
for
circuitandself-biasedWas todecreasethe better
loop designed voltageripples
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