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第8章 数字电路3 8.2 组合逻辑电路 1. 常量与变量的关系 三. 逻辑函数的化简 1.用 “与非”门构成基本门电路 8.2.2 组合逻辑电路的分析与综合 1. 组合逻辑电路的分析 8.2.3 组合逻辑电路的设计 一. 加法器 8.2.4 中规模组合逻辑电路的应用 一. 加法器 1. 半加器 2. 全加器 二. 编码器 2. 二 – 十进制编码器 三. 译码器和数字显示 CT74LS139型译码器 2. 二-十进制显示译码器 CT74LS4147 编码器功能表 I9 Y0 I8 I7 I6 I5 I4 I3 I2 I1 Y1 Y2 Y3 1 1 1 1 1 1 1 1 1 1 1 1 1 输 入 (低电平有效) 输 出(8421反码) 0 ? ? ? ? ? ? ? ? 0 1 1 0 1 0 ? ? ? ? ? ? ? 0 1 1 1 1 1 0 ? ? ? ? ? ? 1 0 0 0 1 1 1 0 ? ? ? ? ? 1 0 0 1 1 1 1 1 0 ? ? ? ? 1 0 1 0 1 1 1 1 1 0 ? ? ? 1 0 1 1 1 1 1 1 1 1 0 ? ? 1 1 0 0 1 1 1 1 1 1 1 0 ? 1 1 0 1 1 1 1 1 1 1 1 1 0 1 1 1 0 例:CT74LS147集成优先编码器(10线-4线) T4147引脚图 低电平 有效 16 15 14 13 12 11 10 9 1 2 3 4 5 6 7 8 CT74LS4147 译码是编码的反过程，它是将代码的组合译成一个特定的输出信号。 1. 二进制译码器 8个 3位 译码器 二进制代码 高低电平信号 状 态 表 例：三位二进制译码器（输出高电平有效） 输 入 A B C Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 0 0 0 1 0 0 0 0 0 0 0 0 0 1 0 1 0 0 0 0 0 0 0 1 0 0 0 1 0 0 0 0 0 0 1 1 0 0 0 1 0 0 0 0 1 0 0 0 0 0 0 1 0 0 0 1 0 1 0 0 0 0 0 1 0 0 1 1 0 0 0 0 0 0 0 1 0 1 1 1 0 0 0 0 0 0 0 1 输 出 写出逻辑表达式 Y0=A B C Y1=A B C Y2=A B C Y3=A B C Y7=A B C Y4=A BC Y6=A B C Y5=A B C 逻辑图 C B A 1 1 1 Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 0 1 1 1 0 0 1 0 0 0 0 0 0 0 A A B B C C 例：利用译码器分时将采样数据送入计算机 总线 2-4线译码器 A B C D 三态门 三态门 三态门 三态门 译码器工作 总线 译码器工作 工作原理：(以A0A1= 00为例) 0 0 0 总线 2-4线译码器 A B C
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