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网络工程师 之计算机硬件基础(三) 高级项目经理 任铄 QQ ：1530841586 本章内容 2 本章内容 • 1.1 计算机结构 • 1.2 存储器 • 1.3 输入输出系统 3 三、Cache Cache高速缓冲存储器是存在于主存与CPU之间 的一级存储器，由静态存储芯片(SRAM)组成， 容量比较小但速度比主存高得多，接近于CPU的 速度。但其成本更高，因此Cache的容量要比内 存小得多。Cache存储了频繁访问内存的数据。 (1) Cache原理、命中率、失效率 使用Cache改善系统性能的主要依据是程序的局部 性原理。 CPU寄存器 cache 主存 主存 磁盘 辅存 可移动存储介质 命中率、失效率 Cache的访问命中率为h （通常1-h就是Cache的失 效率），Cache的访问周期时间是t1 ，主存储器的 访问周期时间是t2 ，则整个系统的平均访存时间就 是：t =h x t + （1-h ）x t 3 1 2 高级项目经理 任铄 QQ ：1530841586 例如，某流水线计算机主存的读/写时间为100ns ， 有一个指令和数据合一的Cache ，该Cache的读/写 时间为10ns ，取指令的命中率为98% ，取数据的命 中率为95%。在执行某类程序时，约有1/5指令需 要存／取一个操作数。假设指令流水线在任何时候 都不阻塞，则设置Cache后，每条指令的平均访存 时间约为多少？ (2) Cache存储器的映射机制 分配给Cache的地址存放在一个相联存储器（CAM ）中。CPU发生访存请求时，会先让CAM判断所要 访问的字的地址是否在Cache中，如果命中就直接 使用。这个判断的过程就是Cache地址映射，这个 速度应该尽可能快。 常见的映射方法有： • 直接映射 • 全相联映射 • 组相联映射 1、直接映射 是一种多对一的映射关系，但一个主存块只能够 复制到Cache的一个特定位置上去。 Cache的行号i 和主存的块号j 有函数关系： i=j%m （其中m为Cache总行数） 高级项目经理 任铄 QQ ：1530841586 例如，某Cache容量为16KB （可用14位表示） ，每行的大小为16B （即可用4位表示），则说 明其可分为1024行（可用10位表示）。 主存地址的低4位为Cache的行内地址，中间10 位为Cache行号。 如果内存地址为1234E8F8H ，那么最后4位就是 1000 （对应十六进制数的最后一位），而中间 10位，则应从E8F(111010001111)中获取，得 到1010001111 。 2、全相联映射 将主存中一个块的地址与块的内容一起存于Cache 的行中，任一主存块能映射到Cache中任意行（主 存块的容量等于Cache行容量）。速度更快，但控 制复杂。 3、组相联映射 是前两种方式的折中方案。它将Cache中的块再分 成组，各组之间是直接映像，而组内各块之间则是 全相联映像。 高级项目经理 任铄 QQ ：1530841586 例如，容量为64块的Cache采用组相联方式映射 ，字块大小为128个字，每4块为一组。若主存容 量为4096块，且以字编址，那么主存地址