体系结构级低能耗Cache与动态电压缩放技术研究.pdf

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体系结构级低能耗Cache和动态电压缩放技术研究 算法通过计算该程序段的频率缩放因子口(片外工作时间与片上工作时间的比例关 系)来设定CPU的电压和频率。结果表明,该算法在保证系统性能的前提下,有效 地降低了处理器的能耗。 否发生变化,并做出Cache容量及CPU电压和频率的调整决定。在程序段内,该算 率调整策略,先后对Cache容量及CPU电压和频率进行调整。结果表明,该算法在 保证性能的前提下,更大程度上地节省了系统的能耗。 关键词:低能耗;Cache;动态电压缩放;有效位;标识比较;自适应算法;运行程 序段 Ill Abstract Withthe ofICfabrication and of lastingdevelopment techniques,thedensityspeed the increase the increase makes density chip rapidly,whichpower becomeafirst·classconstraintin architecture.In like design computer performance,has than can ofCPUismuchfaster thatof modern memory.Cache computer,thespeed the between and main is low—speedmemory.Cache bridgegap high—speedprocessor all roleon the of itconsumes playingimportantoptimizingperformancecomputer,but mainSOurcesof CPU.Sincethe coreandcachearethe of processor significantenergy in their has means energydissipationsignificant energydissipationcomputer,reducing forthe fortheembedded computersystem,especially system. Thedissertationstudieslow methodsinstructurelevel.The energydesign energy arereduced cachestructureand of anditscache

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