基于FPGA与ARM的智能合并单元设计.pdfVIP

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2016-02-24 发布于安徽
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基于FPGA与ARM的智能合并单元设计.pdf

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第 35 卷第 6 期电网技术 Vol. 35 No. 6 2011 年 6 月 Power System Technology Jun. 2011 文章编号：1000-3673 （2011 ）06-0010-05 中图分类号：TM 734 文献标志码：A 学科代码：470·4054 基于 FPGA 与ARM 的智能合并单元设计朱超，黄灿，梅军，郑建勇（东南大学电气工程学院，江苏省南京市 210096 ） Design of Smart Merging Unit Based on FPGA and ARM ZHU Chao, HUANG Can, MEI Jun, ZHENG Jianyong (School of Electrical Engineering, Southeast University, Nanjing 210096, Jiangshu Province, China) ABSTRACT: To meet the requirements of smart substations 0 引言 for digital information, integrated functions and compact 近年来，智能电网成为世界范围内电力系统的 structure, the definitions of merging unit in IEC 60044-8 and IEC 61850-9-1/2 are analyzed, and on this basis a smart 发展方向，受到广泛关注与研究，其涵盖了发电、 merging unit based on field-programmable gate array (FPGA) 输电、变电、配电等多个工程领域[1-2] 。智能变电站 and advanced RISC machines (ARM) is designed. The 是坚强智能电网的重要组成部分，采用智能设备实 auxiliary processor FPGA is responsible for synchronously 现全站信息数字化、通信平台网络化、信息共享标 receiving multi-channel data from different electronic 准化。合并单元(merging unit，MU)作为重要的智能 transformers and implementing the parallel operation and switching-over of busbar by integrated logical control 设备，是实现智能变电站的基础和支撑。 mechanism software; the main ARM processor is responsible 为加快智能变电站建设，国家电网公司先后发布 for the real-time control of FPGA and sending the sampled data 了《智能变电站技术导则》、《110(66)千伏~220 千 in the form specified in IEC 61850-9-2 by Ethernet, and the 伏智能变电站设计规范》、《330 千伏~750 千伏智能 pre-configured sampled value control block is util