EDA技术实用教程第三章AFPGA结构与配置解读.ppt

CPLD isp --IN-SYSTEM-PROGRAMMERBALE LATTICE 的isp下载方式 ISP功能提高设计和应用的灵活性 减少对器件的触摸和损伤 不计较器件的封装形式 允许一般的存储 样机制造方便 支持生产和测试流程中的修改 允许现场硬件升级 迅速方便地提升功能 未编程前先焊接安装 系统内编程--ISP 在系统现场重编程修改 此接口既可作编 程下载口，也可作 JTAG接口 ALTERA 的 ByteBlaster（MV）下载接口 FPGA的配置方案 FPGA的3种常用的 标准下载配置模式 1、Passive Serial Mode 3、JTAG Mode 2、Active Serial Mode FPGA配置 JTAG配置端口 FPGA PS配置端口 PC机 配置适配电路 配置器件 或配置电路 AS配置端口 专用FLASH 配置器件 3.7.1 CPLD的JTAG方式编程 图3-47 CPLD编程下载连接图 TCK、TDO、TMS、TDI为CPLD的JTAG口 对CPLD编程 图3-48 多CPLD芯片ISP编程连接方式 3.7.1 CPLD的ISP方式编程 3.7.2 使用PC并行口配置FPGA 图3-49 FLEX10K PS模式配置时序 图3-50 多FPGA芯片配置电路 FLEX、ACEX、APEX等系列