可预置的定时器显示报警系统的设计精要.docVIP

可预置的定时器显示报警系统的设计精要.doc

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沈阳航空 课 程 设 计 班级 学号 学 生 姓 名 指 导 教 师 沈阳航空课 程 设 计 任 务 书 课 程 名 称 电子线路综合课程设计 课程设计题目 课程设计的内容及要求: 一、……5秒,0秒时显示);系统能准确地预置和清零。 直流电源由直流稳压电源来提供。 三、设计原理 晶振的输出分频器分频后得到标准的秒脉冲,作为计数器的时钟脉冲;预置时间用拨码盘控制,其输出是编码器的十进制输入,编码器的输出预置了计数器所要计数的时间。计数器通过组合逻辑控制锁存器的使能端,将计数器的数据锁存(注意本系统时5秒锁存一次);锁存器的锁存数据经过译码器译码显示,当计数器计数到预置的时间时发出信号报警。 四、设计要求 1.在选择器件时,应考虑成本。 2.根据技术指标,通过分析计算确定电路和元器件参数。 3.画出电路原理图(元器件标准化,电路图规范化)。 五、实验要求 1.根据技术指标制定实验方案;验证所设计的电路,用软件仿真。 2.进行实验数据处理和分析。 六、推荐参考资料 1.沙占友、李学芝著 . 中外数字万用表电路原理与维修技术 [M] .北京:人民邮电出版社,1993年 2.童诗白、华成英主编者 . 模拟电子技术基础 [M] .北京:高等教育出版社,2006年 3.戴伏生主编 . 基础电子电路设计与实践 [M] .北京:国防工业出版社,2002年 4.谭博学主编 . 集成电路原理与应用[M].北京:电子工业出版社,2003年 (例如:、仿真结果)设计报告的规范化、参考文献充分最终评定成绩(以优、良、中、及格、不及格评定) 概述 ……5秒,0秒时显示);系统能准确地预置和清零。 直流电源由直流稳压电源来提供。 方案论证’/RBO’端。使得当0~30中个位是0或者5的数显示出来。 方案一原理框图如图1所示。 图1 方案一的原理框图 方案二: 用两片74LS160级联设计一个0~30的31进制加法计数器,使之每隔一秒计数一次。后将计数器两组的输出端分别接到两个4位寄存器74LS74上,再将两个寄存器的输出端接到显示译码器74LS47的输入端,显示译码器的输出用来驱动共阳极数码管,用来显示时间。其中控制部分的电路需要用两个比较器74LS85,比较计数器低位片的输出与0和5比较。两个比较器的输出或运算后接到寄存器的时钟信号端。当计数器低位片的输出结果等于0或等于5时寄存器有一个脉冲信号。此时的数码管显示的值会发生一次变化。结果使在0~4秒显示00;5~9秒显示05;10~14显示10;15~19显示15;20~24显示20;25~29显示25;30显示30。 方案二原理框图如图2所示。 图2 方案二的原理框图 本设计选用的是方案二,方案二的仿真和实际结果更加符合题目要求和实际需要,设计原理简单易懂。可行性好。 电路设计 图3 直流稳压电源电路原理 2.555定时器多谐振荡电路 原理图如图4所示。电路的振荡周期: T=(R1+R2)C1ln2 (1) R1为51千欧,R2为47千欧,C1为10uF。通过计算得振荡周期T=1s。 图4 多谐振荡器电路原理图 3.计数电路 31进制从0到30计数,用两片74160级联完成。采用置数法设计电路。 电路原理图如图5所示。U1为高位片,U2为低位片。初始设置数为0.将低位片的RCO进位端接到高位片的ENP、ENT上形成两个74LS160的级联。此时低位片为十进制的加法计数器,将高位片的QA、QB两个管脚接出,分别连接到一与非门的两个输入端,输出端接到两个74LS160的~LOAD端。最后得到一个31进制,由0到30的加法计数器。 图5 31进制从0到30计数计数器原理图 4.计数器的复位及清零电路 计数器的复位及清零电路的原理图如图6所示。级联后的31进制加法计数器的~CLR端接到一单刀双掷开关上。单刀双掷开关的另外两端分别接电源VCC和地。当开关接到VCC时,~CLR接入高电位,清零端无效,计数器正常计数。当开关接到地上。则计数器的~CLR端有效。清零功能开启,实现了30秒计时的清零和复位工作。 图6 计数器的复位及清零电路的原理图 5.寄存器电路 寄存器电路原理图如图7所示。 D 图7 寄存器电路原理图 将两片74LS160计数器的QA,QB,QC,QD分别接到两个移位寄存器74LS175的D1,D2,D3,D4上。其输出接到显示译码器74LS47的A,B,C,D上。两个寄存器的锁存信号由Uo2提供。

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