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（2）逻辑功能 触发器有两个互补的输出端， （3）波形分析例1 在用与非门组成的基本RS触发器中，设初始0，已知输入R、S的波形图，画出两输出端的波形图。 基本触发器的特点总结： （1）有两个互补的输出端，有两个稳定的状态。 （2）有复位（Q=0）、置位（Q=1）、保持原状态三种功能。 （3）R为复位输入端，S为置位输入端，可以是低电平有效，也可以是高电平有效，取决于触发器的结构。(我们讲的是低电平有效) （4）无论是复位还是置位，有效信号只需要作用很短的一段时间，即“一触即发”。 二、 同步RS触发器 给触发器加一个时钟控制端CP，只有在CP端上出现时钟脉冲时，触发器的状态才能改变。这种触发器称为同步触发器。 1．同步RS触发器的电路结构 2．逻辑功能 当CP＝0时，控制门G3、G4关闭，触发器的状态保持不变。 当CP＝1时，G3、G4打开，其输出状态由R、S端的输入信号决定。 3．触发器功能的几种表示方法 触发器的功能除了可以用功能表表示外，还有几种表示方法： （1）特性方程 由功能表画出卡诺图得特性方程： （3）驱动表 驱动表是用表格的方式表示触发器从一个状态变化到另一个状态或保持原状态不变时，对输入信号的要求。 4．同步触发器存在的问题——空翻 三、 主从JK触发器 3．JK触发器逻辑功能的几种表示方法 (1）功能表： （3）状态转换图 （4）驱动表 例 已知主从JK触发器J、K的波形如图所示，画出输出Q的波形图（设初始状态为0）。 五、D触发器 1．D触发器的逻辑功能 D触发器只有一个触发输入端D，因此，逻辑关系非常简单； D触发器的状态转换图： 例 已知D触发器的输入波形，画出输出波形图。 解：在波形图时，应注意以下两点： （1）触发器的触发翻转发生在CP的上升沿。 （2）判断触发器次态的依据是CP上升沿前一瞬间输入端D的状态。 六、触发器应用举例 例 设计一个3人抢答电路。3人A、B、C各控制一个按键开关KA、KB、KC和一个发光二极管DA、DB、DC。谁先按下开关，谁的发光二极管亮，同时使其他人的抢答信号无效。 利用触发器的“记忆”作用，使抢答电路工作更可靠、稳定。 时序逻辑电路的一般分析方法 分析时序逻辑电路的一般步骤 1．由逻辑图写出下列各逻辑方程式： （1）各触发器的时钟方程。 （2）时序电路的输出方程。 （3）各触发器的驱动方程。 2．将驱动方程代入相应触发器的特性方程，求得时序逻辑电路的状态方程。 3．根据状态方程和输出方程，列出该时序电路的状态表，画出状态图或时序图。 4．根据电路的状态表或状态图说明给定时序逻辑电路的逻辑功能。 二、移位寄存器 移位寄存器——不但可以寄存数码，而且在移位脉冲作用下，寄存器中的数码可根据需要向左或向右移动1位。 设移位寄存器的初始状态为0000，串行输入数码DI=1101，从高位到低位依次输入。其状态表如下： 右移寄存器的时序图： 由于右移寄存器移位的方向为DI→Q0→Q1→Q2→Q3，所以又称上移寄存器。 （2）左移寄存器 2 ．双向移位寄存器 将右移寄存器和左移寄存器组合起来，并引入一控制端S便构成既可左移又可右移的双向移位寄存器。 5.3 计数器 一、二进制计数器 1．二进制异步计数器 （1）二进制异步加法计数器（4位） 用“观察法”作出该电路的时序波形图和状态图。 由时序图可以看出，Q0、Ql、Q2、Q3的周期分别是计数脉冲(CP)周期的2倍、4倍、8倍、16倍，因而计数器也可作为分频器。 （2）二进制异步减法计数器 用4个上升沿触发的D触发器组成的4位异步二进制减法计数器。 二进制异步减法计数器的时序波形图和状态图。 在异步计数器中，高位触发器的状态翻转必须在相邻触发器产生进位信号（加计数）或借位信号（减计数）之后才能实现，所以工作速度较低。为了提高计数速度，可采用同步计数器。 二、非二进制计数器 N进制计数器又称模N计数器。 然后将各驱动方程代入JK触发器的特性方程，得各触发器的次态方程: （3）作状态转换表。 （4）作状态图 和时序图。 （5）检查电路能否自启动 用同样的分析方法分别求出6种无效状态下的次态，得到完整的状态转换图。 2．8421BCD码异步十进制加法计数器 （3）作状态转换表。 举例 例：试分析如图所示的时序逻辑电路。 （3）写出JK触发器的特性方程，然后将各驱动方程代入JK触发器的特性方程，得各触发器的次态方程： （4）作状态转换表及状态图