计算机组成原理卷集.doc

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计算机组成原理卷集

说明:请在答题纸上答题 一.选择题(每题1分,共6分) 1.在下述存储器中,允许随机访问的存储器是( )。 ①磁带 ②磁盘 ③磁鼓 ④半导体存储器 2.在下面的结论中,( )正确。 ①主存是主机的一部分,不能通过单总线被访问 ②主存可以和外围设备一样地,通过单总线被访问 ③主存是主机的一部分,必须通过专用总线进行访问 ④主存是主机的一部分,必须通过内总线进行访问 3.下列设备中,哪种适于通过DMA方式与主机进行信息交换( )。 ①键盘 ②电传输入机 ③针式打印机 ④磁盘 4.下列存储器中,( )存取时间的长短与信息所在的位置有关。 ①主存 ②调整缓存 ③磁带 ④固存 5.磁表面存储器所记录的信息( )。 能长期保存 ②不能长期保存 ③读出后,原存信息即被破坏 ④读出若干次后要重写 6.在调频制记录方式中,记录0时,写电流( )变化一次。 ①在只在本位单元中间位置处 ②只在本位单元起始位置处 ③本位单元起始位置处负向 ④在本位单元起始位置和中间位置处各 二.填空题(每空1分,共20分) 计算机主机是由 和 两部分组成。 有一个 7,4 码,其生成多项式G x 1011,则数据1010的CRC码为 。 某机字长4位,若[x]补 1110,则[-x]补 ,[-x]移 。 在存储系统的层次结构中,CPU可直接访问的存储器是 。 时序控制有 、 和 三种方式。 浮点数字长16位,其中阶码含阶符共4位,移码表示,尾数含一位数符共12位,补码表示,规格化。则真值(-25×0.375)10浮点数代码应为 。 直接寻址方式,指令中的地址码部分给出的是操作数的 。 设置高速缓冲存储器的目的是 ,其实现依据是 。 9.动态RAM刷新有4种方式,分别为 、 、 、 。 10.总线优先权控制有 、 及 三种实现方法。 三、判断题(正确打“?”错误打“×”,每题3分,共18分) CPU同时接受到外部中断请求和DMA请求时,CPU优先响应外部中断请求。( ) 当Cache的各个块都被占用后,CPU就将无法再使用它。( ) 中断向量和向量中断含义相同。( ) 74181只能完成加减运算。( ) 微程序由用户编制,存放于主存中。( ) 6.大多数微型机的总线由地址总线,数据总线和控制总线组成,因此,它们是三总线结构的。( ) 四、简述题(每题5分,共25分) 磁盘存储器的地址格式如何?为什么要采用这种格式? 简述中断处理的一般过程。 水平型微指令,微命令字段的编码方法有哪些?每种方法的基本思想如何? 简述浮点加减法的运算步骤。 简述控制器的组成,并说明各部分功能。 五、计算题(请写出详细步骤)(第1~2题每题6分,第3题5分,共17分) 用Booth 算法计算, 已知 x - 0.1001 , y +0.1011 求 x×y,写出分步运算过程。 2.设数的阶码为3位,尾数为6位(均不包括符号位),已知x 2--011×0.01011, y 2--0015× -- 0.01010 , 用补码形式计算x+y。 3.一个磁盘组有8面,每一面的存储区的内径20cm,外径30cm,磁盘的最大位密度为1600bps,磁道间最小间隔为0.25mm,转速为3600rpm,问 该磁盘组可以存储的最大位数为多少? 对该磁盘的平均存取时间(设平均找道时间为20ms)与数据传输率。 六、编写微程序(8分) 已知一CPU内部的数据通路如下图所示。部件U的输入/输出分别用Ui和Uo表示, 1?R,1?W,Add分别表示读主存、写主存、ALU加法控制信号。 请写出指令 ADD A, X 设该指令为单字节, X为立即数 的微操作序列。 指令功能:(A)+X ? A 七、现有8K×8位的ROM和8K×4位的RAM芯片若干,程序存储器地址空间为 6000H~9FFFH,用ROM芯片构成,数据存储器地址空间为0000H~5FFFH,用RAM芯片构成,请选用上述芯片构造这样的存储器,画出逻辑连接图。(6分) 、选择题(每题1分,共6分) 1.④ 2.② 3.④ 4.③ 5.① 6.② 二、填空题(每空1分,共20分) 1.CPU 主存(或: 主存 CPU) 2.1010011 3.0010 1010 4.主存 5.同步、异步、联合 6.1(阶符) 100 1(数符)01000000000 7.有效地址 8.提高CPU的利用率,程序的局部性访问原理 9.集中、分散、异步、透明 10.链式查询、计数器定时查询、独立请求方式 三、判断题(正确打“?”错误打“×”,每题3分,共18分) 1. X 2. X 3.X 4.X 5.X 6.X 四、简述题(每题5分,共25分) 驱动

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