八位十进制数字频率计设计报告.docVIP

题 目： 作 者： 学 号： 所属学院： 专业年级： 完成时间： 8位十进制数字频率计的设计 摘 要 数字频率计是用数字显示被测信号频率的仪器，被测信号是方波信号。数字频率计广泛应用于科研机构、学校、实验室、企业生产车间等场所。研究数字频率计的设计和开发，有助于频率计功能的不断完善、性价比的提高和实用性的加强。 本文介绍了一种自顶向下分层设计多功能数字频率计的设计方法。该频率计采用 Verilog 硬件描述语言编程，以 QuartusII为开发环境，极大地减少了硬件资源的占用。数字频率计模块划分的设计具有相对独立性，可以对模块单独进行设计、调试和修改，缩短了设计周期。所设计的Verilog语言通过仿真能够较好的测出所给频率并且满足数字频率计的自动清零和自动测试的功能要求，具有理论与实践意义。关键词：Verilog ;数字频率计; EDA; QuartusII 第一章 EDA技术原理与概述 1.1可编程逻辑器件基本原理 FPGA [4-5]是一种高密度的可编程逻辑器件,自从Xilinx公司1985年推出第一片FPGA以来,FPGA的集成密度和性能提高很快,其集成密度最高达1000万门/片以上,系统性能可达300MHz。由于FPGA器件集成度高,