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燕 山 大 学 课 程 设 计 说 明 书 第 PAGE \* MERGEFORMAT 14 页 共 12 页 第一章 设计说明 1.1设计思路 自动电子钟是应用六个静态数码管显示时、分、秒的。时、分、秒的显示分别对应两个静态数码管。分和秒的设计需要采用从00到59的六十进制循环计数，小时部分需要从00到23的二十四进制循环计数。上电之后从“00：00：00”开始显示。 秒和分的部分分别应用两个74160十进制计数器以并行进位方式连接成六十进制计数器，都采用异部置零端CLRN进行计数，分的部分采用同步置零端LDN进行计数。当给进1HZ的时钟信号后，以秒的进位输出作为分的时钟输入，从而显示分的数值；以分的进位输出作为时的时钟输入，从而显示时的数值，当到达23：59：59时进行下一个循环。 1.2 模块介绍 RCO 进位输出端 CLK 时钟输入端 CLRN 异步清零端（上升沿有效） ENP 计数控制端 ENT 计数控制端 ABCD 并行数据输入端 LDN 同步并行置入控制端 QA--QD 输出端 该设计是使用74160，与非门，反相器三个元器件连接而成的。 74160是同步十进制计数器，其芯片图如下（图1），右侧为各引脚的功能表。