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- 2017-06-08 发布于河南
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基于Matlab的锁相环设计
指导老师:宋明歆
学 生:刘惠珊
班 级:电科10-2
学号:1007010212
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本次答辩内容
1.研究目的与意义
2.基本原理
3.工作任务
4.锁定性能
5.环路性能
6.稳定性能
7.调制作用
8.结论
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目的与意义
锁相环(Phase Locked Loop)的输出信号能够自动跟踪输入信号的频率和相位变化,它具有独特的窄带跟踪性能,既能跟踪输入信号,又能对输入噪声进行窄带滤波。
在现代集成电路中,锁相环是一种广泛应用于模拟、数字及数模混合电路系统中的非常重要的电路模块。在通信和数字系统中可以作为时钟恢复电路应用;在电视和无线通信系统中可以用作频率合成器来选择不同的频道;PLL还可应用于频率调制信号的解调。总之,PLL已经成为许多电子系统的核心部分。因此,研究锁相环具有重要意义。
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基本原理
1.鉴相器(PD )是相位比较装置,它把输出信号)和参考信号的相位进行比较,产生对应于两信号相位差
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