微型计算机原理与接口技术第7章中断new分析.ppt

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微型计算机原理与接口技术第7章中断new分析

第七章 微型计算机中断系统 中断概述 8086 CPU的中断系统 可编程中断控制器8259A 中断概述 中断的基本概念 中断处理过程 中断优先级和中断嵌套 中断的基本概念 什么是中断 中断源 中断的作用 中断系统的功能 什么是中断 中断是现代微型计算机系统中广泛采用的一种资源共享方式 所谓中断,当CPU正常运行程序时,由于微处理器内部事件或外设请求,引起CPU中断正在运行的程序,转去执行中断服务子程序,中断服务子程序执行完后,返回被中止的程序继续往下执行,这一过程称为中断。 中断图示 中断源 引起中断的事件称为中断源。 内部事件: 中断指令 INT n CPU错误,如除法错误、运算溢出 其他紧急事件,如电源掉电 外部事件: 外部设备发出的中断,如键盘,实时时钟 协处理器发出的中断 中断的作用 并行处理 实时处理 故障处理 中断系统的功能 中断系统是指实现硬件中断而设置的各种硬件和软件,包括中断控制逻辑和管理相应中断的指令 中断系统包括以下功能: 能发送中断请求,接受中断响应,执行中断服务程序和返回中断 能实现中断优先级管理 能实现中断嵌套 中断处理过程 可屏蔽中断处理过程 CPU响应中断必须满足的条件 CPU响应中断后所要做的工作 中断服务程序 非屏蔽中断处理过程 可屏蔽中断处理流程图 CPU响应中断必须满足的条件 外设提出中断请求 本中断位未被屏蔽 本中断优先级最高 CPU中断允许,即IF=1(指令STI设置中断标志位IF=1,指令CLI设置中断标志位IF=0) 中断响应信号INTA CPU响应中断后,对外设接口发出两个中断响应信号INTA。 第一个INTA:通知外设接口(或中断控制器),准备好中断类型信息 第二个INTA:中断接口电路通过数据总线向CPU送中断类型号;CPU从DB获取中断类型号 CPU响应中断后所要做的工作 从数据总线读取中断类型号N 标志寄存器PSW内容入栈 IF?0, TF?0,屏蔽其他外部中断和避免CPU以单步方式执行中断处理程序 保护断点,将当前指令的下一条指令的CS和IP内容入栈 从中断向量表中取IP?(4N,4N+1) CS?(4N+2,4N+3) 转中断服务子程序 中断结束后,恢复现场(如何恢复?),返回断点处继续执行原来的程序 中断服务程序 中断服务程序是预先编制好的一段程序完成中断处理功能,中断服务程序一般包括以下几个部分: 保护相关寄存器内容 开中断:以便中断服务过程能够响应优先级更高的中断请求 执行中断服务 关中断:使中断恢复和中断返回过程不被新的中断请求所中断 恢复相关寄存器内容 中断返回 IRET 非屏蔽中断处理过程 不必判断IF是否为1,也不是由外设接口提供中断类型号,从NMI引脚进入的中断请求规定为类型号2,在运行中断处理程序过程中,若NMI引脚上有中断请求进入,CPU仍能够响应。 软件中断由程序设定,没有随机性,也不受IF的影响,中断类型号由INT N中N指定。正在执行软件中断时,如果有不可屏蔽中断请求,就会在当前指令执行完后立即予以响应;如果有可屏蔽中断请求,并且IF=1,也会在当前指令执行完后予以响应。 中断优先级和中断嵌套 当有多个中断源请求中断时,中断系统判别中断申请的优先级。 CPU响应优先级高的中断,挂起优先级低的中断。 当CPU在运行中断服务子程序时,又有更高优先级的中断申请进入,CPU要挂起原中断进入更高级的中断服务子程序,形成中断的嵌套。 8086 CPU的中断系统 8086 CPU的中断源 中断分类 中断向量和中断向量表 中断响应和中断处理过程 中断服务程序设计 8086中断源 中断分类 外部中断 内部中断 外部中断 外部中断又称硬件中断,是由外部硬件引起的,硬件中断分为: 不可屏蔽中断 可屏蔽中断 8086/8088CPU有两条外部中断请求线: 不可屏蔽中断请求线NMI 可屏蔽中断请求线INTR。 不可屏蔽中断请求 触发方式:采用边沿触发,上升沿有效,上升沿之后维持2个时钟周期高电平 特点:用户不能用软件屏蔽,一旦有NMI请求,CPU必须处理 引起原因:①主板DRAM奇偶校验错误;②I/O通道扩展板奇偶校验错误;③8087有中断请求;④电源掉电 中断类型号为2 可屏蔽中断请求 触发方式:电平触发方式,高电平有效,INTR的高电平必须维持到CPU响应中断才结束 特点:用户可以通过软件设置来屏蔽外部中断。 外设中断请求得到响应的条件:①中断请求是否被屏蔽(由8259的IMR控制);②CPU是否允许响应中断(由CPU的标志寄存器IF位控制)。 引起原因:由8259A管理。外设的中断请求信号接入8259A的IRi端,8259A的INT引脚连到CPU的INTR引脚,可以引起可屏蔽中断。 内部中断(软件中断) 引起内部中断的中断源: 由中断指令INT引起: CPU执

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