fpga verilog FPGA-Verilog试题(西安电子科技大学).doc

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2017-01-11 发布于贵州
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fpga verilog FPGA-Verilog试题(西安电子科技大学) 导读：就爱阅读网友为您分享以下“FPGA-Verilog试题(西安电子科技大学)”的资讯，希望对您有所帮助，感谢您对92的支持! 西安电子科技大学考试时间分钟试题题号一二三四五六七八九十总分分数 1.考试形式：闭（开）卷；2.本试卷共四大题，满分100分。班级学号姓名任课教师一、选择题（每题2分，共18分） 1. 下面哪个是可以用verilog语言进行描述，而不能用VHDL语言进行描述的级别？（ A ） (A) 开关级 (B)门电路级 (C) 体系结构级 (D) 寄存器传输级 2.在verilog中，下列语句哪个不是分支语句？（ D ） (A) if-else (B) case (C) casez (D) repeat 3．下列哪些Verilog的基本门级元件是多输出（ D ） (A) nand (B) nor (C) and (D) not 4．Verilog连线类型的驱动强度说明被省略时，则默认的输出驱动强度为（ B ） (A) supply (B) strong (C) pull (D) weak 5.元件实例语句“notif1 #(1:3:4,2:3:4,1:2:4) U1(out,in,ctrl);”中截至延迟的典型值为（ B ） (A) 1 (B) 2 (C) 3 (D) 4 6．已知 “a =1b1; b=3b#39;001;”那么{a,b}＝（ C ）