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输入输出
输入输出 陆海宁 hnlu@sjtu.edu.cn 外设和I/O模块 I/O操作是通过各种外部设备来完成的 广义上看,外设分成三类 人可读的 显示屏、打印机、键盘 机器可读的 磁盘、传感器 通信设备 网卡,调制解调器 外部设备通过I/O模块与计算机系统连接 I/O模块通用模型 为什么需要I/O模块 各种外设使用不同的操作逻辑 各种外设使用不同的数据格式和字长度 外设的速度往往比存储器或处理器慢很多 外部设备的框图 I/O模块的功能 控制和定时 处理器通信 设备通信 数据缓冲 检错 I/O步骤(读操作) CPU查询I/O模块,检测设备状态 I/O模块返回设备状态 如果设备就绪,CPU请求数据传送 I/O模块从外设获取数据 I/O模块将数据传送至CPU 处理器通信 命令译码 数据传输 状态报告 地址识别 I/O模块框图 I/O模块特性 隐藏外设的定式、格式和电子机制等细节,允许处理器以一种简便的方式管理多种类型的设备 支持一个或多个设备 仍将许多控制设备的任务留给处理器 I/O技术 编程式I/O 中断驱动式I/O 存储器直接存取(DMA) I/O技术 编程式I/O 处理器通过I/O模块直接控制外设 检查状态 读/写 命令 传输数据 CPU需要等待,直到I/O模块完成操作 浪费了CPU时间 编程式I/O—具体过程 CPU请求I/O操作 I/O模块执行操作 I/O模块设定某个状态位 CPU周期性的检查这个状态位 I/O不直接通知CPU I/O模块也不中断CPU CPU等到发现操作执行完成为止 I/O命令 CPU指定地址 标识模块和设备 CPU发送命令 控制:告诉模块做什么操作 测试:检查状态 读/写 I/O设备寻址 存储映射式I/O I/O设备和内存共享同一片地址空间 I/O操作看起来就像内存读写 不需要为I/O准备特殊的指令 分离式I/O 分离的地址空间 需要I/O或内存选择线 需要特殊的I/O指令 存储映射式I/O和分离式I/O 中断驱动式I/O 克服了CPU等待的问题 无需CPU周期性的检查状态 在就绪时,I/O模块发出中断 中断驱动式I/O—基本读操作 CPU发出读取命令 I/O模块从外设读取数据,此时CPU处理其他工作 I/O模块中断CPU CPU请求数据 I/O模块传送数据 简单中断处理流程 中断时存储器和寄存器的变化 设计问题 在多个I/O模块的情况下,如何确定哪个模块发出了中断? 如果多个中断出现,处理器怎样确定处理哪个中断,顺序如何? 确定中断模块 不同的模块使用不同的中断线 只能支持有限的设备 软件轮询 CPU轮流询问每个I/O模块 速度慢 确定中断模块 菊花链(硬件轮询,向量) 中断识别信号在模块间链状传播 发出中断的模块将其向量放到总线上 CPU通过向量确定中断处理例程 总线仲裁 模块在发出中断之前必须先获得总线控制权 模块将其向量放到总线上 存储器直接存取 编程式I/O和中断驱动式I/O要求CPU的积极参与 限制了传输率 每次(如:1字)I/O传送,CPU都必须参与 在传输大量数据时,需要DMA技术 DMA功能 总线上的附加硬件模块 DMA接管CPU控制I/O的工作 DMA操作 CPU通知DMA控制器: 读/写 I/O设备的地址 读或写时内存的起始地址 所需传送的数据长度 CPU可以做其他工作了 DMA负责传送数据 直到所有数据传输完成,DMA控制器发出中断信号通知CPU 典型的DMA框图 DMA传输周期窃用 DMA控制器接管总线一个周期 传输一个字的数据 不是一个中断 CPU不转换现场 CPU在访问总线前将被挂起 如取操作数或者存操作数之前 稍微降低了CPU的速度,但比CPU管理传输要高效 指令周期中DMA和中断断点 DMA布局(1) 单一总线,分离的模块 每次传输使用两个总线周期 以读为例:I/O到DMA,然后DMA到内存 CPU需要挂起两次 DMA布局(2) 单一总线,集合的DMA控制器 控制器可以支持多于一个的设备 每次传输只使用一个总线周期 DMA布局(3) 独立的I/O总线 I/O总线支持所有DMA控制的设备 每次传输只使用一个总线周期 I/O通道 I/O设备变得越来越复杂 I/O模块拥有了自己的处理器 CPU指示I/O处理器执行存储器中的I/O程序 提高了速度 降低了CPU的工作负担 专用的处理器提高了性能 I/O通道结构 S.J.T.U. 上海交通大学
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