数电加法计数器无效态000101试题.docx

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目录 1课程设计目的与作用 1 1.1课程设计任务 1 2软件环境介绍 1 3三位二进制加法计数器(无效态:000 101) 1 3.1基本原理 1 3.2设计过程 2 3.3逻辑电路图 5 3.4仿真结果 5 4串行序列检测器设计(检查信号0101) 8 4.1串行序列检测器状态图 8 4.2设计过程 8 4.3逻辑电路图 11 4.4仿真结果 11 5 12及7进制可控计数器设计 13 5.1基本原理 13 5.2设计过程 13 5.3逻辑电路图 15 5.4仿真结果 16 6设计总结与体会 19 7参考文献 19 1课程设计目的与作用 (1) 熟练掌握三位二进制加法器的设计和检测。 (2) 学习并掌握信号的简单检测以及其电路的设计。 (3) 学会利用所学知识设计不同要求的电路以实现不同的逻辑功能。 (4) 熟练multisim的操作技能。 1.1课程设计任务 (1)三位二进制加法计数器(无效态:000 101) (2)串行序列检测器(检测序列:0101) (3)12及7进制可控计数器的设计及仿真 2软件环境介绍 Multisim是加拿大IIT公司推出的基于Wendows的电路仿真软件,由于采用交互式的界面,比较直观,操作方便,具有丰富的元器件库和品种繁多的虚拟仪器,以及强大的分析功能等特点,因而得到了广泛的应用。 针对不同的用户,提供了多种版本,如学生版,教育版,个人版和超级专业版等。其中教育版适合高等学校的教学使用。 启动Multisim后,屏幕上显示主界面。主界面主要由菜单栏,系统工具栏,系统设计栏,设计工具栏,元件工具栏,仪器工具栏,使用中元件列表,仿真开关,状态栏以及电路图编辑窗口等组成。 3三位二进制加法计数器(无效态:000 101) 3.1基本原理 计数器是利用统计脉冲个数的电路,是组成数字电路和计算机电路的基本时序部件,计数器按长短可分为:二进制,十进制和N进制计数器。计数器不仅有加法计数器,也有减法计数器。 如果一个计数器既能完成累加计数的功能,又能完成递减的功能,则称其为可逆计数器。同步计数器:当输入计数脉冲到来时,要更新状态的触发器都是同时翻转的计数器,叫做同步计数器。 3.2设计过程 001 /0 010 /0 011 /0 100 /0 110 /0 111 /1 图3.2三位二进制加法计数器状态图 (1)选择触发器 由于JK触发器功能齐全、使用灵活,故选用3个下降沿JK触发器。 (2)求时钟方程 CP0=CP1=CP2=CP (3)求输出方程 输出方程的卡诺图为: Q1nQ0n Q2n 00 01 11 10 XXX 010 100 011 110 XXX 001 111 图3.2.2输出方程次态卡诺图 输出方程为:Y= Q2nQ0n (4) 状态方程:次态卡诺图: Q1nQ0n Q2n 00 01 11 10 X 0 1 0 1 X 0 1 1 图3.2.3 Q2N+1的次态卡诺图 Q1nQ0n Q2n 00 01 11 10 X 1 0 1 1 X 0 1 0 1 图3.2.4 Q1N+1的次态卡诺图 Q1nQ0n Q2n 00 01 11 10 X 0 0 1 0 X 1 1 图3.2.5 Q0N+1的次态卡诺图 状态方程:

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