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;一、基本实验任务
JK触发器逻辑功能测试（74LS76）。
D触发器逻辑功能测试（74LS74）。
JK触发器转换成D触发器。
D触发器组成三位异步二进制加法计数器。
一位全加器的实现。
（1）用异或门74LS86和74LS00实现。
（2）用3/8线译码器74LS138和74LS20实现。
（3）用双4选1数据选择器74LS153和74LS00实现。
二、扩展任务
JK触发器组成三位异步二进制加法计数器。
D触发器组成三位异步二进制减法计数器。
JK触发器组成三位异步二进制减法计数器。;更正：
（1）报告装订顺序有误，第二张“2.实验部分 （1）用2输入异或门74LS86……”应为第四张。
（2）第一页，“（一）JK触发器逻辑功能测试 （2）JK触发器的触发方式是 即CP脉冲的”后加“ ”。改为“CP脉冲的 沿到来时，……”
（3）第一页，“2.实验部分 实验数据表格”和波形图之间添“JK悬空时，波形记录。”
（4）第二页，“（??）D触发器逻辑功能测试 （2）D触发器的触发方式是 即CP脉冲的”后加“ ”。改为“CP脉冲的 沿到来时，……”
（5）第二页，“2.实验部分 实验数据表格”和波形图之间添“D触发器接触计数式时，波形记录。”
（6）第二页，“（三）JK触发器转换成D触发器。 2.实验部分 表格第三、四行 ‘J=K=0’、‘J=K=1’”的“J=K=”删除。
（7）报告中74LS74的实验练习图芯片管脚应为14个而不是16个。;74LS74;74LS74;74LS76;74LS76;74LS138;74LS138;使能控制端;双四选一集成数据选择器74LS153
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