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2017-04-20 发布于湖北
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项目8 组合逻辑电路-lm

项目8 组合逻辑电路;组合逻辑电路由若干个逻辑门组成的具有一组输入和一组输出的非记忆性逻辑电路，输出仅由输入决定，与电路当前状态无关；电路结构中无反馈环路（无记忆）。;10. 1 组合逻辑电路的分析步骤;最简与或表达式;真值表; 3 ;10.2 组合逻辑电路部件;10.2.1 编码器;逻辑表达式;8421 码编码器;逻辑表达式;3位二进制优先编码器;逻辑表达式;逻辑图;10.2.2 译码器;3位二进制译码器;逻辑表达式;　　二-十进制译码器的输入是十进制数的4位二进制编码（BCD码），分别用A3、A2、A1、A0表示；输出的是与10个十进制数字相对应的10个信号，用Y9～Y0表示。由于二-十进制译码器有4根输入线，10根输出线，所以又称为4线-10线译码器。;真值表;逻辑表达式;显示译码器;;b=c=f=g=1，a=d=e=0时;显示译码器真值表;10.2.4 4选1数据选择器;逻辑图;加法器;分为不考虑低位来的进位和考虑低位进位两种情况;不考虑低位进位，将两个1位二进制数A、B相加的逻辑运算 ;1; 逻辑图;两个半加器构成一个全加器;1 1 0 1;集成多位加法器芯片 ; ;定义两个中间变量Gi和Pi ： ;Si= Ki ⊕Ci-1 ;Si= Ki ⊕Ci-1 ;2. 超前进位集成4位加法器74LS283;74LS283逻辑图;3. 超前进位加法器74LS283的应用