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计算机原理课程设计 成员信息 小组编号 8 成员信息 姓名 学号 实验分工 分值比例 编写测试程序、总体测试、改错、 组长 XXX XXX 0.3 写文档 控制器 CU、PC、各模块的输入输 成员 1 XXX XXX 0.4 出控制、参与部分测试和改错 成员 2 XXX XXX 乘、除、开根号运算模块 0.3 实验目的 学习用 Verilog 语言设计硬件的方法； 学会用系统的工程的思想来设计硬件； 理解 CPU 的工作原理； 学习如何与他人分工合作。 设计内容和要求 基于综合实验平台和 Verilog HDL 设计并实现一个八位字长的计算机： 八位字长的运算器； 指令系统和控制器； 256*1k 字节的存储器； 通用寄存器组； 其他必要部件。 计算机能完成单字节或双字节加/减、单字节无符号乘法、16 位处以 8 位除法等 多种算术运算等基本运算。 设计步骤 1. 设计计算机的总体框图 第 1 页 共 10 页 2. 设计各个功能部件的功能 (1) 算术逻辑运算单元 ALU： 插图 0 ALU_OUT ALU_OUT ALU ALU_OP GR_OUT 第 2 页 共 10 页 信号线描述： GR_OUT:来自 GR 寄存器组的输出作为 ALU 的输入 AC_OUT:来自 AC 寄存器的输出作为 ALU 的另一输入； ALU_OP:ALU 的操作码 5 位； ALU_OUT:ALU 的输入端； 功能简述：完成 AC、GR 传输；带进借位与不带进借位的加减法；按位与、异或； 带进（借）位的循环左（右）移一位。 (2) 程序计数器 PC： 插图 功能简述：特殊的寄存器，有三种功能：保持、加载、计数。如果载入使能为高， 则更新 PC 值；如果计数使能为高，则计数；否则保持。 (3) 通用寄存器 GR： 插图 功能简述：8*8 通用寄存器组，一个写端口，一个读端口，一个读写地址。 (4) 地址寄存器 AR、指令寄存器 IR、累加寄存器 AC、Z 标志寄存器和 C 标志寄 存器是基于同一个模板 register 生成的，此模板寄存器的功能及