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2017-06-14 发布于河南
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;走进时序电路：;Chapter 7 ;Chapter 7 Sequential Logic Design Principles第７章　　时序逻辑设计原理;Review of Basic Concept (基本概念回顾);Basic Concepts (基本概念);Basic Concepts (基本概念)(P521);Basic Concepts (基本概念)(P521);Basic Concepts (基本概念)(P522);Finite-State Machine;Basic Concepts (基本概念)(P522);Basic Concepts (基本概念)(P522);; Why do we need the sequential circuit? ;Time control for data process;思考：能否只用一片1位全加器进行串行加法？？;暂存;7.1 Bistable Elements 双稳态元件;Vin2;所有的时序电路对亚稳态都是敏感的;7.2 Latches and Flip-Flops 锁存器与触发器(P526);锁存器与触发器;S-R Latch (S-R锁存器) S-R Latch with Enable (具有使能端的S-R锁存器) D Latch (D锁存器) Edge-Triggered D Flip-Flops (边沿触发式D触发器) Edge-Triggered D Flip-Flops with Enable (具有使能端的边沿触发式D触发器);Scan Flip-Flops (扫描触发器) Master/Slave Flip-Flops (S-R、J-K） (主从式触发器) Edge-Triggered J-L Flip-Flops (边沿触发式J-K触发器) T Flip-Flop (T触发器);7.2.1 S-R latch (S-R锁存器)(P527);S-R Latch;S-R锁存器;S-R latch;S-R锁存器的功能描述;状态图 ;tpw(min);S-R锁存器的动作特点;7.2.2 S - R latch(P529);7.2.3 S-R Latch with Enable具有使能端的S-R锁存器(P530);0 X X 1 0 0 1 0 1 1 1 0 1 1 1;