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6.时序逻辑电路资料
二—五—十进制异步加法计数器74LS90(74LS290) 74LS90的功能： 74LS175的功能: Cr是异步清零控制端。 74LS194的功能表 二进制计数器的时钟输入端为CP1，输出端为QA，即对CP1计数； 五进制计数器的时钟输入端为CP2，输出端为QB、QC、QD，即对CP2计数。 74LS90包含一个独立的1位二进制计数器和一个独立的五进制计数器。 惯用逻辑符号 电路图 表 6-12 状态迁移表 0 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 0 1 0 1 0 1 1 0 0 1 1 1 1 0 0 0 1 0 0 1 0 1 2 3 4 5 6 7 8 9 CP1 如果将QA与CP2相连，CP1作时钟输入端，QA～QD作输出端，则为8421BCD码十进制计数器。 表 6 – 13 状态迁移表 0 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 1 0 0 0 0 0 1 1 0 1 1 1 1 0 0 0 1 2 3 4 5 6 7 8 9 CP2 如果将QD与CP1相连，CP2作时钟输入端，从高位到低位的输出为QA QD QC QB 时，则构成5421BCD码十进制计数器。 ① 异步清零。 ③ 加法计数。 ② 异步置9 (输出为1001) 。 异步置数 1 0 0 1 1 0 0 1 × × × × 1 1 1 1 0 × × 0 异步清零 0 0 0 0 0 0 0 0 × × × × 0 × × 0 1 1 1 1 0 × 0 × × 0 × 0 R0（1） R0（2） 复位输入 0 × × 0 0 × × 0 R9（1） R9（2） 置位输入 ↓ 0 0 ↓ ↓ Q0 Q3 ↓ CP1 CP2 时 钟 二进制 计 数 五进制 计 数 8421码 计 数 5421码 计 数 QD QC QB QA 输 出 工作模式 加法计数 例 8 用74LS90 组成七进制计数器。 解 七进制计数器有 7 个独立状态。可由十进制计数器采用一定的方法使它跳越3个无效状态而得到，即反馈归零法。 若选用8421BCD十进制计数器，其反馈归零过程如表6-15 所示，当第 7 个CP脉冲作用时按计数要
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