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河南~~~~~~~~学校
实
验
报
告
系部名称: 电子通信工程系
课程名称: 可编程逻辑器件原理与应用
年级班别: ~~~~~~~~
姓 名: ~~~~~~~
学 号: ~~~~~~~~~~~
辅导教师: ~~~~~~~
实验地点: 实字三号楼107
实验时间: 2015年3月16日
提交日期: 2015年3月18日
实验2:图形输入法与层次化设计练习
一、实验目的及要求
通过本实验,使学生初步掌握利用简单电路模块“搭积木式”搭建复杂电路的设计方法,并进一步熟悉QuartusII软件完成电路设计的整个操作流程。
二、实验仪器设备及软件平台
台式电脑、QuartusII 8.0软件、康芯公司EDA/SOPC实验箱。
三、实验设计及调试
1、实验内容
直流电机调速及启停控制电路设计:以程序输入法编写计数器模块和比较器模块,生成占空比可调的PWM波,并连上2选1多路选择器和与门等逻辑电路,完成直流电机控制电路的设计。
2、实验设计
①PWM波脉宽手动调节计数器程序如下:
LIBRARY IEEE ;
USE IEEE.STD_LOGIC_1164.ALL ;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY DECD IS
PORT ( CLK : IN STD_LOGIC;
DSPY : OUT STD_LOGIC_VECTOR(3 DOWNTO 0) ;
D : OUT STD_LOGIC_VECTOR(3 DOWNTO 0) ) ;
END ;
ARCHITECTURE one OF DECD IS
SIGNAL CQ : STD_LOGIC_VECTOR(2 DOWNTO 0);
BEGIN
PROCESS( CQ )
BEGIN
CASE CQ IS
WHEN 000 = D = 0101 ;
WHEN 001 = D = 0110 ;
WHEN 010 = D = 0111 ;
WHEN 011 = D = 1001 ;
WHEN 100 = D = 1011 ;
WHEN 101 = D = 1100 ;
WHEN 110 = D = 1101 ;
WHEN 111 = D = 1111 ;
WHEN OTHERS = NULL ;
END CASE ;
END PROCESS ;
PROCESS(CLK)
BEGIN
IF CLKEVENT AND CLK = 1 then CQ = CQ + 1; END IF;
END PROCESS;
DSPY=0CQ+1;
END ;
②CNT5模块VHDL程序如下:
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY CNT5 IS
PORT ( CLK : IN STD_LOGIC;
AA : OUT STD_LOGIC_VECTOR(4 DOWNTO 1));
END CNT5;
ARCHITECTURE behav OF CNT5 IS
SIGNAL CQI : STD_LOGIC_VECTOR(4 DOWNTO 0);
BEGIN
PROCESS(CLK)
BEGIN
IF CLKEVENT AND CLK = 1 then CQI = CQI + 1; END IF;
END PROCESS;
AA = CQI(4 DOWNTO 1);
END behav;
③顶层原理图搭建如图1所示:
图1 直流电机控制电路图 3、实验步骤
①设计子模块:按照实验1所掌握的方法,依次设计DECD、CNT5、CMP3等三个模块,并完成全部功能仿真确保无误后,生成复用原理图符号;
②顶层设计:按照图1所示,设计顶层电路图;
③建立项目:
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