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2017-08-10 发布于天津
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实验十九集成触发器及其应用电路设计

实验03 实验十九集成触发器及其应用电路设计（说明：CC4027 RD、SD接低电平） 1、验证JK触发器逻辑功能特性（2）功能表(特性表 2、JK触发器触发器JK触发器触发器逻辑特性 (J=K=T) d T触发器特性表JK触发器触发器逻辑特性 ( ) d T触发器特性表触发器JK触发器特性逻辑（2）电路连接原理（逻辑逻辑（3）逻辑函数式、状态图、波形图 a 逻辑函数式 (J0=K0=1) b状态图 c波形图 4、同步3分频电路（1）JK触发器特性逻辑（2）状态表、状态图（3）逻辑函数式: 由卡诺图得: （4）逻辑图（5）波形图 5、可逆计数器（模4）状态真值表（1）JK触发器特性逻辑（4）逻辑图（5）波形图 5 0 1 1 1 1 1 1 0 0 0 ＆＆ 0 1 ＆＆ JK触发器特性表 0 1 0 1 0 1 0 1 0 1 0 Z M 1 × 0 × 1 0 1 JK触发器特性表 0 1 ＆＆ Q1 0 Q1 Q0 0 × 0 1 × CP × FF0 1K 1 1K Q0 CP 10 01 1J Q1Q0 1 00 1J FF1 × 1K 1J × 1 × 1 1 0 1 0 1 1 1 1 5 6 4 7 K0年 J0年 K1 J1年 Q0n+1年 Q1n+1年 Q0n年 0 1 × × 1 2 0 1 0 0 Q1n年 0 0 0 1 0 0 0 1 1 0 1 1 0 3 0 × 1 Q1Q0 M / Z 1/0 1/0 0/0 1/1 0/1 1/0 0/0 11 10 01 0/0 00 0 1 0 1 1 1 0 1 0 0 1 0 1 0 1 0 Q n J K Q n+1 Q n J K Q n+1 0 0 0 0 1 0 0 1 1 Z × 1 × M 1 × 1 × Q1 × 1 （模4）状态真值表 C1 K J Q Q CP 1K 1J C1 K J Q J=× K=1 J=1 K=× 1 0 J=× K=0 J=0 K=× Q CP 1K 1J C1 T Q Q CP 1T J=× K=1 J=1 K=× 1 0 J=× K=0 J=0 K=× T=1 T=1 1 0 T=0 T=0 T触发器特性表 Q n T Q n+1 Q n T Q n+1 0 0 0 1 0 1 T C1 K J Q Q CP 1K 1J d 转换图 JK状态图 T状态图 C1 D Q Q CP 1D D触发器逻辑 D触发器 D=0 D=1 1 0 D=1 D=0 Q0 D触发器特性表 Q n D Q n+1 Q n D Q n+1 0 0 0 1 0 0 CP FF0 1K 0 1 1 1 1 1 1 0 0 1 0 1 1 1 0 1 J1=K1=0 J1=K1=1 J1=K1=1 1 0 J1=K1=0 J0=K0=0 J0=K0=1 J0=K0=1 1 0 J0=K0=0 JK触发器特性表 0 1 0 1 1 1 0 1 0 0 1 0 1 0 1 0 Q n J K Q n+1 Q n J K Q n+1 0 0 0 0 1 0 0 1 电路功能表 J1 C1 1 1 0 1 0 1 0 1 1 0 0 0 1 1 0 1 0 1 0 1 1 0 0 0 Q1n J1=K1（Q0） Q1 n+1 Q0n J0=K0 Q0 n+1 1K 1J Q0 Q0 FF0 J0 =K0 =1 1kHZ C1 1K 1J Q1 Q1