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DTGAL绝热电路 * DTGAL逻辑 nDTGAL pDTGAL 2N-2N2P逻辑 与nDTGAL配套使用 Buffer Full adder Buffer Full adder Buffer 2P-2P2N逻辑 与pDTGAL配套使用 2N-2N2P绝热逻辑 Buffer/inv 结构 逻辑赋值（Ni、Nib） 驱动(N1、N2、P1、P2) 时钟依次延迟1/4个周期 功率时钟通过P1和P2对接点OUTb和OUT充放电。 如何工作（以梯形波为例） 2）IN为高电平时，Ni被打开，Nib关闭,OUTb被钳制 为低电平。通过一个反相器将OUT与功率时钟连通。 功率时钟开始通过P2对OUT准备进行充电，OUT波形开始 尾随功率时钟变化。 5）IN到低电平后， CLK开始下降，OUT通过P2向功率 时钟放电，进行能量回收。 1）IN逐渐由低电平上升到高电平。 3）IN上升到高电平后，开始维持，P2已打开，CLK 开始从低电平上升，OUT也随着CLK上升至高电平。 4）IN开始从高电平下降至低电平，CLK维持高电平不变 OUT也维持高电平。 时序波形 非绝热损耗 程序 **4.2N2N2P缓冲器程序***************************** .subckt inv1 in inb clk vdd out outb mpmos1 out