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一种基于FPGA的8B_10B编解码电路的设计与实现
DOI :10.13 82/j.issn.2095 -533.2010.05.015
2010 年9 月 Sept.2010
第 15 卷 第5 期 JOURNAL OF XIAN UNIVERSITY OF POSTS AND TELECOMMUNICATIONS Vol.15 No.5
FPGA 8B/10B
武小强, 田小平
(西安邮电学院 电子工程学院, 陕西 西安 710121)
:为提高8B/10B 编解码电路的速度和 现低资源消耗, 根据8B/10B 编解码真值表的内在相关性和编码特点,
采用降低查找表 个数的方法, 给出一种基于查找表的 8B/10B 编解码电路设计方案。 验仿真和数据分析显示, 新
方案较现有方案速度更高, 资源消耗更低。
:8B/10B;FPGA;直流平衡;查找表;不平衡度
:TN7 :A :1007-32 4 (2010)05-0027-03
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:2010-05-23
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·28 · 西 安 邮 电 学 院 学 报 2010 年9 月
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