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第七章
第七章 可编程外围接口芯片8255A及其应用
7.1 8255A的工作原理
一、8255A的结构和功能
二、8255A的控制字及初始化编程
三、8255A工作方式和C口状态字
7.2 8255A的应用举例
教材第九章内容
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第七章
7.1 8255A的工作原理
8255A是一种通用的可编程并行I/O接口芯片,一般不需附加外部逻辑电路就可直接为CPU与外设之间提供数据通道; 通过对它进行编程,可为CPU与外设之间的通信提供无条件、有条件和中断方式的接口电路,因此应用较广泛。
8255A综述
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第七章
1、外形
40引脚的芯片;
双列直插式封装;
一、8255A的结构和功能
8255A的引脚图
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第七章
管脚小结:
(1)与外设连接的管脚8255A有三个数据端口,每个端口是8位的,由此与外设相连接的管脚共有24位。
A口有八个I/O引脚 PA7-PA0
B口有八个I/O引脚 PB7-PB0
C口有八个I/O引脚 PC7-PC0
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第七章
(2)与CPU连接的管脚
数据线D7-D0;
读写控制线RD#、WR#;
片选信号CS#;
端口地址控制线A0和A1;
复位线RESET。
(3)电源线和地线
电源线VCC ,一般取+5V ;
电源地线GND。
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第七章
2、内部结构
数据端口A、B、C(其中C口被分成C口上半部分和C口下半部分两个部分)
A组和B组控制逻辑;
数据总线缓冲器;
读/写控制逻辑。
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第七章
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第七章
8255A与系统的连接示意图
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第七章
3、各部分功能简介
数据端口 A、B、C:可用来和外设传送信息;每个端口8位,通过编程设定其为输入口或输出口;
8255数据端口功能表
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第七章
控制端口D (A组和B组控制电路):
8位端口,无对外引脚;接收CPU送的控制字,决定A组和B组的工作方式,或对C口的每位执行置位/复位等操作。
数据总线缓冲器(D0-D7):
由1个8位双向三态缓冲器构成;8255A内各端口通过数据缓冲器与系统总线相连。
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第七章
地址译码与读写控制逻辑
根据系统送来的地址信号和控制信号,对数据信息、控制信息和状态信息的传送进行管理。
CS# :片选信号,低有效,有效时允许8255A与CPU交换信息
RD# :读信号,低有效,有效时允许CPU从8255A端口中读数据/状态。
WR# :写信号,低有效,有效时允许CPU将控制字/数据写入8255A。
RESET :复位信号,高有效。复位后,控制寄存器内容被清零。A口、B口和C口被置成输入方式。
A1、A0 :端口的选择信号。
00—端口A 01—端口B 10—端口C 11—端口D(控制口)
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